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/** Common header file for Blackfin family of processors
 *
 * Copyright 2007-2008 Analog Devices Inc.
 *
 * Licensed under the GPL-2 or later.
 */
 
 #ifndef _PORTMUX_H_
 #define _PORTMUX_H_
 
 #define P_IDENT(x)    ((x) & 0x1FF)
 #define P_FUNCT(x)    (((x) & 0x3) << 9)
 #define P_FUNCT2MUX(x)    (((x) >> 9) & 0x3)
 #define P_DEFINED    0x8000
 #define P_UNDEF        0x4000
 #define P_MAYSHARE    0x2000
 #define P_DONTCARE    0x1000
 
 #ifdef CONFIG_PINCTRL
 int bfin_internal_set_wake(unsigned int irq, unsigned int state);
 
 #define gpio_pint_regs bfin_pint_regs
 #define adi_internal_set_wake bfin_internal_set_wake
 
 #define peripheral_request(per, label) (0)
 #define peripheral_free(per)
 #define peripheral_request_list(per, label) (0)
 #define peripheral_free_list(per)
 #else
 int peripheral_request(unsigned short per, const char *label);
 void peripheral_free(unsigned short per);
 int peripheral_request_list(const unsigned short per[], const char *label);
 void peripheral_free_list(const unsigned short per[]);
 #endif
 
 #include <linux/err.h>
 #include <linux/pinctrl/pinctrl.h>
 #include <mach/portmux.h>
 #include <mach/gpio.h>
 
 #ifndef P_SPORT2_TFS
 #define P_SPORT2_TFS P_UNDEF
 #endif
 
 #ifndef P_SPORT2_DTSEC
 #define P_SPORT2_DTSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT2_DTPRI
 #define P_SPORT2_DTPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT2_TSCLK
 #define P_SPORT2_TSCLK P_UNDEF
 #endif
 
 #ifndef P_SPORT2_RFS
 #define P_SPORT2_RFS P_UNDEF
 #endif
 
 #ifndef P_SPORT2_DRSEC
 #define P_SPORT2_DRSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT2_DRPRI
 #define P_SPORT2_DRPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT2_RSCLK
 #define P_SPORT2_RSCLK P_UNDEF
 #endif
 
 #ifndef P_SPORT3_TFS
 #define P_SPORT3_TFS P_UNDEF
 #endif
 
 #ifndef P_SPORT3_DTSEC
 #define P_SPORT3_DTSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT3_DTPRI
 #define P_SPORT3_DTPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT3_TSCLK
 #define P_SPORT3_TSCLK P_UNDEF
 #endif
 
 #ifndef P_SPORT3_RFS
 #define P_SPORT3_RFS P_UNDEF
 #endif
 
 #ifndef P_SPORT3_DRSEC
 #define P_SPORT3_DRSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT3_DRPRI
 #define P_SPORT3_DRPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT3_RSCLK
 #define P_SPORT3_RSCLK P_UNDEF
 #endif
 
 #ifndef P_TMR4
 #define P_TMR4 P_UNDEF
 #endif
 
 #ifndef P_TMR5
 #define P_TMR5 P_UNDEF
 #endif
 
 #ifndef P_TMR6
 #define P_TMR6 P_UNDEF
 #endif
 
 #ifndef P_TMR7
 #define P_TMR7 P_UNDEF
 #endif
 
 #ifndef P_TWI1_SCL
 #define P_TWI1_SCL P_UNDEF
 #endif
 
 #ifndef P_TWI1_SDA
 #define P_TWI1_SDA P_UNDEF
 #endif
 
 #ifndef P_UART3_RTS
 #define P_UART3_RTS P_UNDEF
 #endif
 
 #ifndef P_UART3_CTS
 #define P_UART3_CTS P_UNDEF
 #endif
 
 #ifndef P_UART2_TX
 #define P_UART2_TX P_UNDEF
 #endif
 
 #ifndef P_UART2_RX
 #define P_UART2_RX P_UNDEF
 #endif
 
 #ifndef P_UART3_TX
 #define P_UART3_TX P_UNDEF
 #endif
 
 #ifndef P_UART3_RX
 #define P_UART3_RX P_UNDEF
 #endif
 
 #ifndef P_SPI2_SS
 #define P_SPI2_SS P_UNDEF
 #endif
 
 #ifndef P_SPI2_SSEL1
 #define P_SPI2_SSEL1 P_UNDEF
 #endif
 
 #ifndef P_SPI2_SSEL2
 #define P_SPI2_SSEL2 P_UNDEF
 #endif
 
 #ifndef P_SPI2_SSEL3
 #define P_SPI2_SSEL3 P_UNDEF
 #endif
 
 #ifndef P_SPI2_SSEL4
 #define P_SPI2_SSEL4 P_UNDEF
 #endif
 
 #ifndef P_SPI2_SSEL5
 #define P_SPI2_SSEL5 P_UNDEF
 #endif
 
 #ifndef P_SPI2_SSEL6
 #define P_SPI2_SSEL6 P_UNDEF
 #endif
 
 #ifndef P_SPI2_SSEL7
 #define P_SPI2_SSEL7 P_UNDEF
 #endif
 
 #ifndef P_SPI2_SCK
 #define P_SPI2_SCK P_UNDEF
 #endif
 
 #ifndef P_SPI2_MOSI
 #define P_SPI2_MOSI P_UNDEF
 #endif
 
 #ifndef P_SPI2_MISO
 #define P_SPI2_MISO P_UNDEF
 #endif
 
 #ifndef P_TMR0
 #define P_TMR0 P_UNDEF
 #endif
 
 #ifndef P_TMR1
 #define P_TMR1 P_UNDEF
 #endif
 
 #ifndef P_TMR2
 #define P_TMR2 P_UNDEF
 #endif
 
 #ifndef P_TMR3
 #define P_TMR3 P_UNDEF
 #endif
 
 #ifndef P_SPORT0_TFS
 #define P_SPORT0_TFS P_UNDEF
 #endif
 
 #ifndef P_SPORT0_DTSEC
 #define P_SPORT0_DTSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT0_DTPRI
 #define P_SPORT0_DTPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT0_TSCLK
 #define P_SPORT0_TSCLK P_UNDEF
 #endif
 
 #ifndef P_SPORT0_RFS
 #define P_SPORT0_RFS P_UNDEF
 #endif
 
 #ifndef P_SPORT0_DRSEC
 #define P_SPORT0_DRSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT0_DRPRI
 #define P_SPORT0_DRPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT0_RSCLK
 #define P_SPORT0_RSCLK P_UNDEF
 #endif
 
 #ifndef P_SD_D0
 #define P_SD_D0 P_UNDEF
 #endif
 
 #ifndef P_SD_D1
 #define P_SD_D1 P_UNDEF
 #endif
 
 #ifndef P_SD_D2
 #define P_SD_D2 P_UNDEF
 #endif
 
 #ifndef P_SD_D3
 #define P_SD_D3 P_UNDEF
 #endif
 
 #ifndef P_SD_CLK
 #define P_SD_CLK P_UNDEF
 #endif
 
 #ifndef P_SD_CMD
 #define P_SD_CMD P_UNDEF
 #endif
 
 #ifndef P_MMCLK
 #define P_MMCLK P_UNDEF
 #endif
 
 #ifndef P_MBCLK
 #define P_MBCLK P_UNDEF
 #endif
 
 #ifndef P_PPI1_D0
 #define P_PPI1_D0 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D1
 #define P_PPI1_D1 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D2
 #define P_PPI1_D2 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D3
 #define P_PPI1_D3 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D4
 #define P_PPI1_D4 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D5
 #define P_PPI1_D5 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D6
 #define P_PPI1_D6 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D7
 #define P_PPI1_D7 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D8
 #define P_PPI1_D8 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D9
 #define P_PPI1_D9 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D10
 #define P_PPI1_D10 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D11
 #define P_PPI1_D11 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D12
 #define P_PPI1_D12 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D13
 #define P_PPI1_D13 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D14
 #define P_PPI1_D14 P_UNDEF
 #endif
 
 #ifndef P_PPI1_D15
 #define P_PPI1_D15 P_UNDEF
 #endif
 
 #ifndef P_HOST_D8
 #define P_HOST_D8 P_UNDEF
 #endif
 
 #ifndef P_HOST_D9
 #define P_HOST_D9 P_UNDEF
 #endif
 
 #ifndef P_HOST_D10
 #define P_HOST_D10 P_UNDEF
 #endif
 
 #ifndef P_HOST_D11
 #define P_HOST_D11 P_UNDEF
 #endif
 
 #ifndef P_HOST_D12
 #define P_HOST_D12 P_UNDEF
 #endif
 
 #ifndef P_HOST_D13
 #define P_HOST_D13 P_UNDEF
 #endif
 
 #ifndef P_HOST_D14
 #define P_HOST_D14 P_UNDEF
 #endif
 
 #ifndef P_HOST_D15
 #define P_HOST_D15 P_UNDEF
 #endif
 
 #ifndef P_HOST_D0
 #define P_HOST_D0 P_UNDEF
 #endif
 
 #ifndef P_HOST_D1
 #define P_HOST_D1 P_UNDEF
 #endif
 
 #ifndef P_HOST_D2
 #define P_HOST_D2 P_UNDEF
 #endif
 
 #ifndef P_HOST_D3
 #define P_HOST_D3 P_UNDEF
 #endif
 
 #ifndef P_HOST_D4
 #define P_HOST_D4 P_UNDEF
 #endif
 
 #ifndef P_HOST_D5
 #define P_HOST_D5 P_UNDEF
 #endif
 
 #ifndef P_HOST_D6
 #define P_HOST_D6 P_UNDEF
 #endif
 
 #ifndef P_HOST_D7
 #define P_HOST_D7 P_UNDEF
 #endif
 
 #ifndef P_SPORT1_TFS
 #define P_SPORT1_TFS P_UNDEF
 #endif
 
 #ifndef P_SPORT1_DTSEC
 #define P_SPORT1_DTSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT1_DTPRI
 #define P_SPORT1_DTPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT1_TSCLK
 #define P_SPORT1_TSCLK P_UNDEF
 #endif
 
 #ifndef P_SPORT1_RFS
 #define P_SPORT1_RFS P_UNDEF
 #endif
 
 #ifndef P_SPORT1_DRSEC
 #define P_SPORT1_DRSEC P_UNDEF
 #endif
 
 #ifndef P_SPORT1_DRPRI
 #define P_SPORT1_DRPRI P_UNDEF
 #endif
 
 #ifndef P_SPORT1_RSCLK
 #define P_SPORT1_RSCLK P_UNDEF
 #endif
 
 #ifndef P_PPI2_D0
 #define P_PPI2_D0 P_UNDEF
 #endif
 
 #ifndef P_PPI2_D1
 #define P_PPI2_D1 P_UNDEF
 #endif
 
 #ifndef P_PPI2_D2
 #define P_PPI2_D2 P_UNDEF
 #endif
 
 #ifndef P_PPI2_D3
 #define P_PPI2_D3 P_UNDEF
 #endif
 
 #ifndef P_PPI2_D4
 #define P_PPI2_D4 P_UNDEF
 #endif
 
 #ifndef P_PPI2_D5
 #define P_PPI2_D5 P_UNDEF
 #endif
 
 #ifndef P_PPI2_D6
 #define P_PPI2_D6 P_UNDEF
 #endif
 
 #ifndef P_PPI2_D7
 #define P_PPI2_D7 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D18
 #define P_PPI0_D18 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D19
 #define P_PPI0_D19 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D20
 #define P_PPI0_D20 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D21
 #define P_PPI0_D21 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D22
 #define P_PPI0_D22 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D23
 #define P_PPI0_D23 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW0
 #define P_KEY_ROW0 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW1
 #define P_KEY_ROW1 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW2
 #define P_KEY_ROW2 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW3
 #define P_KEY_ROW3 P_UNDEF
 #endif
 
 #ifndef P_KEY_COL0
 #define P_KEY_COL0 P_UNDEF
 #endif
 
 #ifndef P_KEY_COL1
 #define P_KEY_COL1 P_UNDEF
 #endif
 
 #ifndef P_KEY_COL2
 #define P_KEY_COL2 P_UNDEF
 #endif
 
 #ifndef P_KEY_COL3
 #define P_KEY_COL3 P_UNDEF
 #endif
 
 #ifndef P_SPI0_SCK
 #define P_SPI0_SCK P_UNDEF
 #endif
 
 #ifndef P_SPI0_MISO
 #define P_SPI0_MISO P_UNDEF
 #endif
 
 #ifndef P_SPI0_MOSI
 #define P_SPI0_MOSI P_UNDEF
 #endif
 
 #ifndef P_SPI0_SS
 #define P_SPI0_SS P_UNDEF
 #endif
 
 #ifndef P_SPI0_SSEL1
 #define P_SPI0_SSEL1 P_UNDEF
 #endif
 
 #ifndef P_SPI0_SSEL2
 #define P_SPI0_SSEL2 P_UNDEF
 #endif
 
 #ifndef P_SPI0_SSEL3
 #define P_SPI0_SSEL3 P_UNDEF
 #endif
 
 #ifndef P_SPI0_SSEL4
 #define P_SPI0_SSEL4 P_UNDEF
 #endif
 
 #ifndef P_SPI0_SSEL5
 #define P_SPI0_SSEL5 P_UNDEF
 #endif
 
 #ifndef P_SPI0_SSEL6
 #define P_SPI0_SSEL6 P_UNDEF
 #endif
 
 #ifndef P_SPI0_SSEL7
 #define P_SPI0_SSEL7 P_UNDEF
 #endif
 
 #ifndef P_UART0_TX
 #define P_UART0_TX P_UNDEF
 #endif
 
 #ifndef P_UART0_RX
 #define P_UART0_RX P_UNDEF
 #endif
 
 #ifndef P_UART1_RTS
 #define P_UART1_RTS P_UNDEF
 #endif
 
 #ifndef P_UART1_CTS
 #define P_UART1_CTS P_UNDEF
 #endif
 
 #ifndef P_PPI1_CLK
 #define P_PPI1_CLK P_UNDEF
 #endif
 
 #ifndef P_PPI1_FS1
 #define P_PPI1_FS1 P_UNDEF
 #endif
 
 #ifndef P_PPI1_FS2
 #define P_PPI1_FS2 P_UNDEF
 #endif
 
 #ifndef P_TWI0_SCL
 #define P_TWI0_SCL P_UNDEF
 #endif
 
 #ifndef P_TWI0_SDA
 #define P_TWI0_SDA P_UNDEF
 #endif
 
 #ifndef P_KEY_COL7
 #define P_KEY_COL7 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW6
 #define P_KEY_ROW6 P_UNDEF
 #endif
 
 #ifndef P_KEY_COL6
 #define P_KEY_COL6 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW5
 #define P_KEY_ROW5 P_UNDEF
 #endif
 
 #ifndef P_KEY_COL5
 #define P_KEY_COL5 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW4
 #define P_KEY_ROW4 P_UNDEF
 #endif
 
 #ifndef P_KEY_COL4
 #define P_KEY_COL4 P_UNDEF
 #endif
 
 #ifndef P_KEY_ROW7
 #define P_KEY_ROW7 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D0
 #define P_PPI0_D0 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D1
 #define P_PPI0_D1 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D2
 #define P_PPI0_D2 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D3
 #define P_PPI0_D3 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D4
 #define P_PPI0_D4 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D5
 #define P_PPI0_D5 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D6
 #define P_PPI0_D6 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D7
 #define P_PPI0_D7 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D8
 #define P_PPI0_D8 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D9
 #define P_PPI0_D9 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D10
 #define P_PPI0_D10 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D11
 #define P_PPI0_D11 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D12
 #define P_PPI0_D12 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D13
 #define P_PPI0_D13 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D14
 #define P_PPI0_D14 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D15
 #define P_PPI0_D15 P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D0A
 #define P_ATAPI_D0A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D1A
 #define P_ATAPI_D1A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D2A
 #define P_ATAPI_D2A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D3A
 #define P_ATAPI_D3A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D4A
 #define P_ATAPI_D4A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D5A
 #define P_ATAPI_D5A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D6A
 #define P_ATAPI_D6A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D7A
 #define P_ATAPI_D7A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D8A
 #define P_ATAPI_D8A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D9A
 #define P_ATAPI_D9A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D10A
 #define P_ATAPI_D10A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D11A
 #define P_ATAPI_D11A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D12A
 #define P_ATAPI_D12A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D13A
 #define P_ATAPI_D13A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D14A
 #define P_ATAPI_D14A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_D15A
 #define P_ATAPI_D15A P_UNDEF
 #endif
 
 #ifndef P_PPI0_CLK
 #define P_PPI0_CLK P_UNDEF
 #endif
 
 #ifndef P_PPI0_FS1
 #define P_PPI0_FS1 P_UNDEF
 #endif
 
 #ifndef P_PPI0_FS2
 #define P_PPI0_FS2 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D16
 #define P_PPI0_D16 P_UNDEF
 #endif
 
 #ifndef P_PPI0_D17
 #define P_PPI0_D17 P_UNDEF
 #endif
 
 #ifndef P_SPI1_SSEL1
 #define P_SPI1_SSEL1 P_UNDEF
 #endif
 
 #ifndef P_SPI1_SSEL2
 #define P_SPI1_SSEL2 P_UNDEF
 #endif
 
 #ifndef P_SPI1_SSEL3
 #define P_SPI1_SSEL3 P_UNDEF
 #endif
 
 
 #ifndef P_SPI1_SSEL4
 #define P_SPI1_SSEL4 P_UNDEF
 #endif
 
 #ifndef P_SPI1_SSEL5
 #define P_SPI1_SSEL5 P_UNDEF
 #endif
 
 #ifndef P_SPI1_SSEL6
 #define P_SPI1_SSEL6 P_UNDEF
 #endif
 
 #ifndef P_SPI1_SSEL7
 #define P_SPI1_SSEL7 P_UNDEF
 #endif
 
 #ifndef P_SPI1_SCK
 #define P_SPI1_SCK P_UNDEF
 #endif
 
 #ifndef P_SPI1_MISO
 #define P_SPI1_MISO P_UNDEF
 #endif
 
 #ifndef P_SPI1_MOSI
 #define P_SPI1_MOSI P_UNDEF
 #endif
 
 #ifndef P_SPI1_SS
 #define P_SPI1_SS P_UNDEF
 #endif
 
 #ifndef P_CAN0_TX
 #define P_CAN0_TX P_UNDEF
 #endif
 
 #ifndef P_CAN0_RX
 #define P_CAN0_RX P_UNDEF
 #endif
 
 #ifndef P_CAN1_TX
 #define P_CAN1_TX P_UNDEF
 #endif
 
 #ifndef P_CAN1_RX
 #define P_CAN1_RX P_UNDEF
 #endif
 
 #ifndef P_ATAPI_A0A
 #define P_ATAPI_A0A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_A1A
 #define P_ATAPI_A1A P_UNDEF
 #endif
 
 #ifndef P_ATAPI_A2A
 #define P_ATAPI_A2A P_UNDEF
 #endif
 
 #ifndef P_HOST_CE
 #define P_HOST_CE P_UNDEF
 #endif
 
 #ifndef P_HOST_RD
 #define P_HOST_RD P_UNDEF
 #endif
 
 #ifndef P_HOST_WR
 #define P_HOST_WR P_UNDEF
 #endif
 
 #ifndef P_MTXONB
 #define P_MTXONB P_UNDEF
 #endif
 
 #ifndef P_PPI2_FS2
 #define P_PPI2_FS2 P_UNDEF
 #endif
 
 #ifndef P_PPI2_FS1
 #define P_PPI2_FS1 P_UNDEF
 #endif
 
 #ifndef P_PPI2_CLK
 #define P_PPI2_CLK P_UNDEF
 #endif
 
 #ifndef P_CNT_CZM
 #define P_CNT_CZM P_UNDEF
 #endif
 
 #ifndef P_UART1_TX
 #define P_UART1_TX P_UNDEF
 #endif
 
 #ifndef P_UART1_RX
 #define P_UART1_RX P_UNDEF
 #endif
 
 #ifndef P_ATAPI_RESET
 #define P_ATAPI_RESET P_UNDEF
 #endif
 
 #ifndef P_HOST_ADDR
 #define P_HOST_ADDR P_UNDEF
 #endif
 
 #ifndef P_HOST_ACK
 #define P_HOST_ACK P_UNDEF
 #endif
 
 #ifndef P_MTX
 #define P_MTX P_UNDEF
 #endif
 
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 #define P_MRX P_UNDEF
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